RTL Design Engineer
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Alten · Valbonne, FrancePrepare for this interview
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About the role
Conception et développement de blocs RTL au cœur d'un Bluetooth Controller, dans un contexte ASIC industriel avec fortes contraintes de performance, fiabilité et low‑power. Connaissances techniques principales : RTL / ASIC Verilog / SystemVerilog FSM complexes, datapaths, blocs de contrôle Optimisation area / perf / power Simulation et debug RTL (VCS, Xcelium, ModelSim...) Notions de synthèse, contraintes timing, CDC, lint Bluetooth (atout fort) Link Layer BLE (Advertising, Scanning, Connections) PHY 1M / 2M / Coded, Audio LE Sécurité (AES / CCM) Un background Wireless / SoC peut suffire si pas d'expérience Bluetooth directe. Collaboration & vérification Interaction étroite avec équipes Embedded SW, Validation, Back‑End Compréhension de testbenches SystemVerilog (UVM appréciée) Profil & expérience Diplôme ingénieur / Master (électronique, microélectronique, télécoms) ≥ 3 ans d'expérience en RTL design ASIC Soft skills Rigueur technique, capacité de debug Autonomie, esprit d'équipe Communication claire en anglais
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Company Intel
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